1746-P3

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LMK04800 的输出有数字延时和模拟延时，在多数应用时数字延时的调整精度已经能满足了，因此不*模拟延时调整，另外模拟延时会带来输出时钟噪底的恶化，一般会恶化3-5db。数字延时的精度取决于第二级集成VCO

　　如果VCO_DIV 没有用或者用外部的VCO，则分子必须等于1 。当延时设置完成后，必须有同步事件才能使得设置生效，同步可以通过寄存器，硬件管脚去触发。当明白了数字延时的调整精度，再结合PCB 传输延时就可以计算出zui大的调整误差。如果Device Clock 是1GHz，而此时VCO 的频率是3GHz，则根据上面公式调整精度是167ps，另外我们需要考虑到器件不同输出通道的Skew，这里假设±30ps， 另外还需要考虑到SYSREF和Device Clock 的PCB 长度不等长，这里假设0.5cm，约±30ps，则我们可以得到SYSREF 可调整的窗口：

　　图中400ps 是LMK04800 LVDS 的输出的上升沿和下降沿所用时间（上升沿和下降沿都是200ps）。 图中我们可以根据以上的条件计算得到调整精度是167ps， Device Clock 的周期是1000ps，则可调整的窗口为1000-400-120=480ps，即为红色的的影映区域，当SYSREF 的上升沿在红色的区域调整时，Device clock 可以容易的检测到SYSREF 的上升沿，否则需要等到下一个Device clock 周期才能检测到SYSREF 上升沿。

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